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高性能FPGA的设计与PCB设计的平行进行因应系统设计挑战

发布时间 :2017-09-18 10:54 阅读 : 来源 :技术文章责任编辑 :深圳宏力捷PCB设计部
复杂度日益增加的系统设计要求高性能FPGA的设计与PCB设计平行进行。透过整合FPGA和PCB设计工具以及采用高密度互连(HDI)等先进的制造制程,这种设计方法可以降低系统成本、最佳化系统性能并缩短设计周期。
 
电子产业背后的推动力是对更快、更便宜的产品的需求以及在竞争厂商之前将产品推向市场。IC技术的进步一直以来就是促使功能增加和性能提高的主要因素之一,而FPGA技术也一直以非常快的速度在发展。与过去FPGA仅仅用作胶合逻辑不同的是,现在FPGA已经被用来实现主要系统功能。FPGA的逻辑闸数已达1,000万,核心速度达到400MHz,能提供高达11Gbps的下一代晶片间通讯速度。而与此同时,它仍然保持着非常合理的成本,因此,与ASIC和定制IC相比,FPGA是一种更具有吸引力的选择。
 
IC和FPGA技术的进步对下游产业产生的效应影响到了PCB产业,这些高接脚数和高性能封装推动新的PCB生产及设计技术具有诸如嵌入被动元件、Gb讯号和EMI分析等功能,并对专用的高密度和高性能布线提出了需求。基本的系统设计方法也在产生变化,对FPGA和PCB的设计可以平行进行以降低系统成本、最佳化系统性能并缩短设计周期。
 
PCB和FPGA一般是在不同的设计环境下建立,过去这些设计方案很少相互沟通。然而,随着高性能、高密度FPGA元件的日益流行,为满足紧凑的上市时间表,如今PCB和FPGA设计团队必须平行工作,不断地交换数据和资讯以确保整个系统设计获得成功。
 
当在PCB上实现高阶FPGA时,设计工程师面临性能最佳化和系统设计生产率的双重挑战。设计工程师必须问自己:是什么问题使得过程慢了下来?需要做什么来获得最佳性能?这些问题的答案可帮助他们找出可实现更小、更便宜和更快系统的解决方案。
 
设计效率的挑战
设计工程师需要平行设计PCB和FPGA时,FPGA设计工程师再也不能像以前那样独立地设计,然后将完成的FPGA设计交给PCB设计工程师就可了事。一个有竞争力的设计要求FPGA和PCB设计工程师从上至下的协作,各自做些折衷以保证最后得到一个最佳系统。平行设计的好处是它能减少设计周期、最佳化系统性能并降低制造成本。
 
平行设计的挑战在于FPGA布局和布线工具得到的结果需要淮确、迅速地映射到原理图和PCB布局中,同时PCB设计的任何改变也必须在FPGA上更新。传统的设计过程是先设计FPGA,然后再将它们交给PCB设计工程师进行电路板实现,如今这种做法不再可行。
 
如果FPGA设计/合成、布局/布线以及PCB设计环境没有被整合,FPGA和PCB方案之间的沟通必须用人工的方法来实现。对于有几百个接脚的小型FPGA,这可能还可以接受,但是,如今很多设计拥有多个高度复杂的FPGA,使用这种方法进行资讯沟通将非常浪费时间,并容易出错。仅仅是高接脚数FPGA的PCB原理图符号的建构和更新,就可以凸显这个问题。
 
另外一个问题涉及到PCB上的大型FPGA。与小型FPGA的符号不同,大型FPGA的单个符号在一张原理图放不下。这些符号必须透过功能分组被分成几个符号,并在FPGA的设计反覆过程中保持不变。
 
FPGA设计工程师花费大量时间调整性能、选择正确的I/O接脚驱动器/接收器,然而FPGA的设计并非仅受FPGA设计工程师的控制。当在PCB上进行FPGA的布局和布线时,设计环境可能要求改变FPGA的接脚分配,如果PCB工具中没有FPGA设计规则,这可能成为一个重覆而费时的过程。
 
此外,FPGA的I/O分配也成了一个系统问题。设计工具需要能够管理接脚分配,但它们必须能被PCB和FPGA设计工程师用来沟通接脚约束。PCB设计工程师无法产生一个阻止FPGA时序收敛的条件,而FPGA设计工程师也不能产生一个阻止系统时序收敛的条件。
 
FPGA的32位元汇流排必须直接与左边连接器进行通讯,这是一个高速汇流排,其上所有网路必须匹配以获得适当的偏斜控制。
 
为使所有的走线长度与最长网路相匹配,布线器增加很多蛇形走线。从PCB布线的角度来看,其结果是一团糟:有很多额外的拥塞、太多额外的走线以及一个工作性能并非最佳的汇流排。
 
布线器也对所有的走线长度与最长走线进行了匹配。即使这样,每条走线的长度也只有1.8英吋,而此前为3.2英吋,更短的匹配长度使汇流排延迟减少到320皮秒。这种性能最佳化是整合FPGA和PCB设计过程的结果,它可获得理想的FPGA接脚图。
 
这个例子说明了在PCB上装配FPGA可能存在的挑战,包括:额外的拥塞需要更长的PCB设计时间完成布线;并非最佳的系统性能;额外的布线要求额外的PCB层,进而增加制造成本。
 
功能方面的障碍
IC和FPGA元件已经过最佳化以便得到更高性能,例如,它们现在能够实现每秒数Gb的串列通讯性能。从时序收敛、讯号完整性以及全面降低PCB布线密度的角度来看,这种方法有以下几个优点:
1.时序校淮没那么严格:时脉包含在串列讯号内,因此设计工程师不需要管理时脉和数据之间的时序;
2.改善讯号完整性:所有讯号都使用差分线对,可提高讯号品质;
3.布线简化:串列讯号沿一条路径(实际上是差分线对)传输,而不是在具有多条走线的汇流排上平行传输,这意味着互连需要较少的走线和层数;
4.晶片上端接:透过在FPGA内整合可变电阻端接器,板上需要的表面黏着元件更少,可以节省空间并提高性能。在更新的元件裡还包含了晶片上电容,可节省更多的空间。
 
在系统中使用这些高阶FPGA则使PCB设计成为整个系统设计取得成功的关键途径,其中系统必须能高速执行,并具有生产成本效益,还能按时完成设计。
 
每秒数Gb的通讯速度要求一套能够进行讯号走线并验证的全新工具。这时PCB上的走线、连接器和过孔也需要消耗功率,必须小心地对它们建模,用经典的讯号完整性分析方法计算延迟、过衝/下衝和串扰。另外还必须用理解位元模式、预加重、均衡和眼图,对工作在GHz频率范围的串列连接进行建模。EDA和FPGA供应商也正在协作,以‘设计套件’的形式提供淮确的元件模型、设计约束和参考设计,这都将提高设计品质并缩短设计周期。
 
串列I/O还需要由公共系统约束驱动的改进的PCB布局和布线技术,另外还须根据最大的匹配延迟以及用到的过孔数量严格控制差分线对的走线。
 
先进的PCB制造技术
高阶FPGA的高接脚数和高接脚密度产生的另一个挑战是需要将FPGA装配到PCB上,然后再将它们连接到板上的其它IC。在很小的面积上有如此多接脚,以致采用普通PCB制造制程几乎不可能进行内部连线。其结果是,这些元件促进了先进PCB制造技术的采用,例如高密度互连(HDI)以及嵌入被动元件等。
 
HDI在PCB上使用IC制造技术。HDI层沉积在传统PCB压合层上(例如FR4),可以制造出很窄的走线和很小的过孔(微过孔),并很容易使扇出远离高密度封装,通常是球栅阵列(BGA)或晶片级封装(CSP)。另外,使用这些HDI技术还需要能够理解这种PCB和IC混合生产技术的专用PCB布局软体。
 
HDI/微过孔的好处包括:
1.减少产品尺寸:PCB基板的高度和厚度降低,体积也减小了;
2.增加走线密度:每个元件的连线更多,而元件布置得更紧密;
3.降低成本:HDI能减少电路板的层数和面积,使每块大的裸板能产出更多电路板,削减生产成本;
4.改善电气性能:HDI的寄生效应只有通孔的十分之一,其引线更短,噪音裕量更大;
5.降低无线电干扰(RFI)/EMI:因为地平面更接近或者就在表层,可利用地平面的分布电容,大大减少RFI/EMI;
6.提高散热效率:HDI层的绝缘介质很薄,温度梯度很高,可提高散热性能;
7.提高设计效率:微过孔使双面布局变得容易,还改善了元件接脚的走线(在焊盘上打过孔),因而留出更多的内层布线空间;
8.提高良品率(DFM):由于间隙很小,HDI板几乎不需要压合;
9.减少层数:通常需要10到12层板的表面贴技术(SMT),采用HDI制造制程只需6层就可以实现;
10.缩短设计周期:由于采用埋孔,布线空间更充足,可显着减少设计时间。
 
此外,这些高接脚数元件需要很多去藕电容和端接电阻以保证工作性能,传统的SMD被动元件会佔用表面层的宝贵面积。透过将这些被动元件嵌入到PCB内层,PCB的尺寸可大幅减少,同时性能也能得到提高。
 
嵌入被动元件具有很多优点,包括:
1.增加设计密度:将被动SMD移入到内层能让其它元件布置得更紧密;
2.降低系统成本:虽然额外的步骤将增加生产成本,但是透过减少SMD并使电路板面积最小化,可降低整体系统成本;
3.减轻系统重量和电路板面积:去除SMD能减少电路板尺寸和重量;
4.提高性能:被动元件可以非常靠近主动元件,这可减少电感,提高性能;
5.提高可靠性和品质:需要装配的SMD越少意味着潜在的焊接故障越少;
6.增加功能:为增加功能创造了机会,而不用担心减少设计面积;
 
就像其它任何新兴技术一样,随着支援它们的基础技术的发展,其成本将下降。嵌入被动元件技术便是如此,它曾经仅用于非常先进的设计,但现在它甚至用在那些要求小尺寸、高功能的消费类产品中。
 
嵌入被动元件的设计关键是要有便于高效设计的自动化工具。如果由人工来定义库元件,那么要设计具有不同参数值和公差的数百个被动元件是不可能的,它需要由电阻和电容特性参数(来自零配件供应商)驱动的自动综合算法。这些综合算法驱动那些分析所有被动元件所需的权衡工具,并帮助确定最佳材料组合和外形尺寸。这些权衡工具有助于减少电路板上的元件数量,减少生产步骤和最终成本。
 
本文小结
从事电子产品设计的公司需要FPGA工具和PCB设计工具进行紧凑、双向地整合,还需要EDA和FPGA供货商紧密合作。有了这种整合与合作,他们才能达到上市时间和性能的目标,否则日益增加的系统设计复杂度将使设计过程停滞不前,并最终消减或吞噬公司的利润。


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